Ritardo critico nei cancelli calcolatrice

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Sottosistema del percorso dati dell'array

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✖Il ritardo di propagazione si riferisce tipicamente al tempo di salita o di discesa nelle porte logiche. Questo è il tempo impiegato da una porta logica per cambiare il suo stato di uscita in base a un cambiamento nello stato di ingresso.ⓘ Ritardo di propagazione [t_pg]			+10% -10%
✖La porta AND con N ingressi è definita come il numero di ingressi nella porta logica AND per l'uscita desiderata.ⓘ N-Ingresso AND Porta [n]			+10% -10%
✖La porta AND con ingresso K è definita come il kesimo ingresso nella porta AND tra le porte logiche.ⓘ Ingresso K AND Porta [K]			+10% -10%
✖Il ritardo del gate AND-OR nella cella grigia è definito come il ritardo nel tempo di calcolo nel gate AND/OR quando la logica viene attraversata.ⓘ Ritardo gate AND-OR [T_ao]			+10% -10%
✖Multiplexer Delay è il ritardo di propagazione del multiplexer. Presenta un numero minimo di PMOS e NMOS, un ritardo minimo e una dissipazione di potenza minima.ⓘ Ritardo del multiplexer [t_mux]			+10% -10%

✖Il ritardo critico nei gate si riferisce al ritardo massimo che può verificarsi in un gate o in una combinazione di gate all'interno di un circuito.ⓘ Ritardo critico nei cancelli [T_gd]

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Formula

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Ritardo critico nei cancelli

Formula

`"T"_{"gd"} = "t"_{"pg"}+("n"+("K"-2))*"T"_{"ao"}+"t"_{"mux"}`

Esempio

`"25.81ns"="8.01ns"+("2"+("7"-2))*"2.05ns"+"3.45ns"`

Calcolatrice

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Ritardo critico nei cancelli Soluzione

FASE 0: Riepilogo pre-calcolo

Formula utilizzata

Ritardo critico nei cancelli = Ritardo di propagazione+(N-Ingresso AND Porta+(Ingresso K AND Porta-2))*Ritardo gate AND-OR+Ritardo del multiplexer
T_gd = t_pg+(n+(K-2))*T_ao+t_mux
Questa formula utilizza 6 Variabili

Variabili utilizzate

Ritardo critico nei cancelli - (Misurato in Secondo) - Il ritardo critico nei gate si riferisce al ritardo massimo che può verificarsi in un gate o in una combinazione di gate all'interno di un circuito.
Ritardo di propagazione - (Misurato in Secondo) - Il ritardo di propagazione si riferisce tipicamente al tempo di salita o di discesa nelle porte logiche. Questo è il tempo impiegato da una porta logica per cambiare il suo stato di uscita in base a un cambiamento nello stato di ingresso.
N-Ingresso AND Porta - La porta AND con N ingressi è definita come il numero di ingressi nella porta logica AND per l'uscita desiderata.
Ingresso K AND Porta - La porta AND con ingresso K è definita come il kesimo ingresso nella porta AND tra le porte logiche.
Ritardo gate AND-OR - (Misurato in Secondo) - Il ritardo del gate AND-OR nella cella grigia è definito come il ritardo nel tempo di calcolo nel gate AND/OR quando la logica viene attraversata.
Ritardo del multiplexer - (Misurato in Secondo) - Multiplexer Delay è il ritardo di propagazione del multiplexer. Presenta un numero minimo di PMOS e NMOS, un ritardo minimo e una dissipazione di potenza minima.

PASSAGGIO 1: conversione degli ingressi in unità di base

Ritardo di propagazione: 8.01 Nanosecondo --> 8.01E-09 Secondo (Controlla la conversione qui)
N-Ingresso AND Porta: 2 --> Nessuna conversione richiesta
Ingresso K AND Porta: 7 --> Nessuna conversione richiesta
Ritardo gate AND-OR: 2.05 Nanosecondo --> 2.05E-09 Secondo (Controlla la conversione qui)
Ritardo del multiplexer: 3.45 Nanosecondo --> 3.45E-09 Secondo (Controlla la conversione qui)

FASE 2: valutare la formula

Sostituzione dei valori di input nella formula

T_gd = t_pg+(n+(K-2))*T_ao+t_mux --> 8.01E-09+(2+(7-2))*2.05E-09+3.45E-09

Valutare ... ...

T_gd = 2.581E-08

PASSAGGIO 3: conversione del risultato nell'unità di output

2.581E-08 Secondo -->25.81 Nanosecondo (Controlla la conversione qui)

RISPOSTA FINALE

25.81 Nanosecondo <-- Ritardo critico nei cancelli

(Calcolo completato in 00.004 secondi)

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Titoli di coda

Creato da Shobhit Dimri

Bipin Tripathi Kumaon Institute of Technology (BTKIT), Dwarahat

Shobhit Dimri ha creato questa calcolatrice e altre 900+ altre calcolatrici!

Verificato da Urvi Rathod

Vishwakarma Government Engineering College (VGEC), Ahmedabad

Urvi Rathod ha verificato questa calcolatrice e altre 1900+ altre calcolatrici!

< 19 Sottosistema del percorso dati dell'array Calcolatrici

Ritardo sommatore Carry-Looker

Partire Ritardo sommatore Carry-Looker = Ritardo di propagazione+Ritardo di propagazione del gruppo+((N-Ingresso AND Porta-1)+(Ingresso K AND Porta-1))*Ritardo gate AND-OR+Ritardo XOR

Ritardo multiplexer

Partire Ritardo del multiplexer = (Ritardo sommatore carry-skip-(Ritardo di propagazione+(2*(N-Ingresso AND Porta-1)*Ritardo gate AND-OR)-Ritardo XOR))/(Ingresso K AND Porta-1)

Carry-Skip Adder Delay

Partire Ritardo sommatore carry-skip = Ritardo di propagazione+2*(N-Ingresso AND Porta-1)*Ritardo gate AND-OR+(Ingresso K AND Porta-1)*Ritardo del multiplexer+Ritardo XOR

Carry-Increamentor Adder Delay

Partire Ritardo sommatore carry-incrementatore = Ritardo di propagazione+Ritardo di propagazione del gruppo+(Ingresso K AND Porta-1)*Ritardo gate AND-OR+Ritardo XOR

Ritardo critico nei cancelli

Partire Ritardo critico nei cancelli = Ritardo di propagazione+(N-Ingresso AND Porta+(Ingresso K AND Porta-2))*Ritardo gate AND-OR+Ritardo del multiplexer

Ritardo di propagazione del gruppo

Partire Ritardo di propagazione = Ritardo della vipera dell'albero-(log2(Frequenza assoluta)*Ritardo gate AND-OR+Ritardo XOR)

Ritardo sommatore albero

Partire Ritardo della vipera dell'albero = Ritardo di propagazione+log2(Frequenza assoluta)*Ritardo gate AND-OR+Ritardo XOR

Capacità della cella

Partire Capacità cellulare = (Capacità di bit*2*Oscillazione di tensione su Bitline)/(Tensione positiva-(Oscillazione di tensione su Bitline*2))

Capacità bit

Partire Capacità di bit = ((Tensione positiva*Capacità cellulare)/(2*Oscillazione di tensione su Bitline))-Capacità cellulare

Oscillazione di tensione sulla bitline

Partire Oscillazione di tensione su Bitline = (Tensione positiva/2)*Capacità cellulare/(Capacità cellulare+Capacità di bit)

Ritardo 'XOR'

Partire Ritardo XOR = Tempo di ondulazione-(Ritardo di propagazione+(Cancelli sul percorso critico-1)*Ritardo gate AND-OR)

Carry-Ripple Adder Ritardo del percorso critico

Partire Tempo di ondulazione = Ritardo di propagazione+(Cancelli sul percorso critico-1)*Ritardo gate AND-OR+Ritardo XOR

Capacità di terra

Partire Capacità di terra = ((Tensione dell'aggressore*Capacità adiacente)/Tensione della vittima)-Capacità adiacente

Area di memoria contenente N bit

Partire Area della cella di memoria = (Area di una cella di memoria da un bit*Frequenza assoluta)/Efficienza dell'array

Area della cella di memoria

Partire Area di una cella di memoria da un bit = (Efficienza dell'array*Area della cella di memoria)/Frequenza assoluta

Efficienza dell'array

Partire Efficienza dell'array = (Area di una cella di memoria da un bit*Frequenza assoluta)/Area della cella di memoria

Addizionatore N-Bit Carry-Skip

Partire Sommatore di salto riporto a N bit = N-Ingresso AND Porta*Ingresso K AND Porta

N-Ingresso 'E' Gate

Partire N-Ingresso AND Porta = Sommatore di salto riporto a N bit/Ingresso K AND Porta

K-Input 'E' Gate

Partire Ingresso K AND Porta = Sommatore di salto riporto a N bit/N-Ingresso AND Porta

Ritardo critico nei cancelli Formula

Ritardo critico nei cancelli = Ritardo di propagazione+(N-Ingresso AND Porta+(Ingresso K AND Porta-2))*Ritardo gate AND-OR+Ritardo del multiplexer
T_gd = t_pg+(n+(K-2))*T_ao+t_mux

Cosa puoi dirci del carry increment adder?

I due sommatori a n bit sono ridondanti in quanto entrambi contengono la logica PG iniziale e la somma finale XOR, riduce la dimensione fattorizzando la logica comune e semplificando il multiplexer in una cella grigia. Questo è chiamato sommatore di incremento del riporto. Utilizza una breve catena ondulata di celle nere per calcolare i segnali PG per i bit all'interno di un gruppo.

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