Effort de ramification Calculatrice

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Caractéristiques de conception CMOS

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Sous-système de chemin de données de tableau

✖La capacité sur le chemin est définie comme la capacité le long du chemin d'analyse.ⓘ Capacité en route [C_onpath]			+10% -10%
✖La capacité hors chemin est définie comme la capacité de la capacité hors chemin de la porte logique.ⓘ Capacité hors parcours [C_offpath]			+10% -10%

✖Le courant d’effort de branchement est dirigé le long du chemin que nous analysons, et une partie est dirigée hors de ce chemin.ⓘ Effort de ramification [b]

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Formule

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Effort de ramification

Formule

`"b" = ("C"_{"onpath"}+"C"_{"offpath"})/"C"_{"onpath"}`

Exemple

`"3.8125"=("3.2pF"+"9pF")/"3.2pF"`

Calculatrice

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Effort de ramification Solution

ÉTAPE 0: Résumé du pré-calcul

Formule utilisée

Effort de branchement = (Capacité en route+Capacité hors parcours)/Capacité en route
b = (C_onpath+C_offpath)/C_onpath
Cette formule utilise 3 Variables

Variables utilisées

Effort de branchement - Le courant d’effort de branchement est dirigé le long du chemin que nous analysons, et une partie est dirigée hors de ce chemin.
Capacité en route - (Mesuré en picofarad) - La capacité sur le chemin est définie comme la capacité le long du chemin d'analyse.
Capacité hors parcours - (Mesuré en picofarad) - La capacité hors chemin est définie comme la capacité de la capacité hors chemin de la porte logique.

ÉTAPE 1: Convertir les entrées en unité de base

Capacité en route: 3.2 picofarad --> 3.2 picofarad Aucune conversion requise
Capacité hors parcours: 9 picofarad --> 9 picofarad Aucune conversion requise

ÉTAPE 2: Évaluer la formule

Remplacement des valeurs d'entrée dans la formule

b = (C_onpath+C_offpath)/C_onpath --> (3.2+9)/3.2

Évaluer ... ...

b = 3.8125

ÉTAPE 3: Convertir le résultat en unité de sortie

3.8125 --> Aucune conversion requise

RÉPONSE FINALE

3.8125 <-- Effort de branchement

(Calcul effectué en 00.021 secondes)

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Accueil » Ingénierie » Électronique » Conception et applications CMOS » Caractéristiques de conception CMOS » Effort de ramification

Crédits

Créé par Shobhit Dimri

Institut de technologie Bipin Tripathi Kumaon (BTKIT), Dwarahat

Shobhit Dimri a créé cette calculatrice et 900+ autres calculatrices!

Vérifié par Urvi Rathod

Collège d'ingénierie du gouvernement de Vishwakarma (VGEC), Ahmedabad

Urvi Rathod a validé cette calculatrice et 1900+ autres calculatrices!

< 24 Caractéristiques de conception CMOS Calculatrices

Capacité du sol à l'agression

Aller Capacité adjacente = ((Victime Conducteur*Rapport de constante de temps*Capacité au sol)-(Conducteur d'agression*Mettre à la terre une capacité))/(Conducteur d'agression-Victime Conducteur*Rapport de constante de temps)

Conducteur victime

Aller Victime Conducteur = (Conducteur d'agression*(Mettre à la terre une capacité+Capacité adjacente))/(Rapport de constante de temps*(Capacité adjacente+Capacité au sol))

Pilote d'agression

Aller Conducteur d'agression = (Victime Conducteur*Rapport de constante de temps*(Capacité adjacente+Capacité au sol))/(Mettre à la terre une capacité+Capacité adjacente)

Tension thermique du CMOS

Aller Tension thermique = Potentiel intégré/ln((Concentration d'accepteur*Concentration des donneurs)/(Concentration électronique intrinsèque^2))

Potentiel intégré

Aller Potentiel intégré = Tension thermique*ln((Concentration d'accepteur*Concentration des donneurs)/(Concentration électronique intrinsèque^2))

Capacité adjacente

Aller Capacité adjacente = (Tension de la victime*Capacité au sol)/ (Tension de l'agresseur-Tension de la victime)

Tension d'agresseur

Aller Tension de l'agresseur = (Tension de la victime*(Capacité au sol+Capacité adjacente))/Capacité adjacente

Tension de la victime

Aller Tension de la victime = (Tension de l'agresseur*Capacité adjacente)/(Capacité au sol+Capacité adjacente)

Effort de ramification

Aller Effort de branchement = (Capacité en route+Capacité hors parcours)/Capacité en route

Phase d'horloge de sortie

Aller Phase d'horloge de sortie = 2*pi*Tension de contrôle VCO*Gain du VCO

Constante de temps de la victime

Aller Constante de temps de la victime = Constante de temps d'agression/Rapport de constante de temps

Constante de temps d'agression

Aller Constante de temps d'agression = Rapport de constante de temps*Constante de temps de la victime

Rapport constant de temps de l'agression à la victime

Aller Rapport de constante de temps = Constante de temps d'agression/Constante de temps de la victime

Tension de contrôle VCO

Aller Tension de contrôle VCO = Tension de verrouillage+Tension de décalage du VCO

Tension de verrouillage

Aller Tension de verrouillage = Tension de contrôle VCO-Tension de décalage du VCO

Tension de décalage VCO

Aller Tension de décalage du VCO = Tension de contrôle VCO-Tension de verrouillage

Changement d'horloge de fréquence

Aller Changement de fréquence d'horloge = Gain du VCO*Tension de contrôle VCO

Facteur de gain unique VCO

Aller Gain du VCO = Changement de fréquence d'horloge/Tension de contrôle VCO

Capacité hors chemin du CMOS

Aller Capacité hors parcours = Capacité en route*(Effort de branchement-1)

Capacitance Onpath

Aller Capacité en route = Capacité totale en scène-Capacité hors parcours

Courant statique

Aller Courant statique = Puissance statique/Tension du collecteur de base

Dissipation de puissance statique

Aller Puissance statique = Courant statique*Tension du collecteur de base

Capacité totale vue par étage

Aller Capacité totale en scène = Capacité en route+Capacité hors parcours

Capacitance Offpath

Aller Capacité hors parcours = Capacité totale en scène-Capacité en route

Effort de ramification Formule

Effort de branchement = (Capacité en route+Capacité hors parcours)/Capacité en route
b = (C_onpath+C_offpath)/C_onpath

Quelle est la signification de l'effort logique ?

L'effort logique fournit un moyen systématique d'analyser et d'optimiser la vitesse des circuits numériques tout en tenant compte de l'impact du dimensionnement des portes, de la diffusion et de la mise à l'échelle de la technologie. C'est un outil précieux pour les concepteurs de circuits numériques pour atteindre l'équilibre souhaité entre les performances, la surface et la consommation d'énergie dans les circuits intégrés modernes.

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