Fanout de la porte Calculatrice

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Sous-système CMOS à usage spécial

Caractéristiques de conception CMOS

Caractéristiques des circuits CMOS

Caractéristiques du retard CMOS

Caractéristiques temporelles CMOS

Mesures de puissance CMOS

Onduleurs CMOS

Sous-système de chemin de données de tableau

✖L'effort d'étape est une mesure de l'effort (ou du délai) nécessaire pour faire passer la sortie d'une porte logique ou d'un circuit à l'étape suivante de la conception.ⓘ Effort de scène [f]			+10% -10%
✖L'effort logique est une métrique qui représente la vitesse intrinsèque d'une porte logique.ⓘ Effort logique [g]			+10% -10%

✖Fanout est le nombre d'entrées de porte similaires qu'une sortie de porte peut piloter. En d’autres termes, il représente le nombre de portes ou de charges connectées à la sortie de la porte actuelle.ⓘ Fanout de la porte [h]

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Formule

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Fanout de la porte

Formule

`"h" = "f"/"g" `

Exemple

`"0.838235"="3.99"/"4.76" `

Calculatrice

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Fanout de la porte Solution

ÉTAPE 0: Résumé du pré-calcul

Formule utilisée

Fanout = Effort de scène/Effort logique
h = f/g
Cette formule utilise 3 Variables

Variables utilisées

Fanout - Fanout est le nombre d'entrées de porte similaires qu'une sortie de porte peut piloter. En d’autres termes, il représente le nombre de portes ou de charges connectées à la sortie de la porte actuelle.
Effort de scène - L'effort d'étape est une mesure de l'effort (ou du délai) nécessaire pour faire passer la sortie d'une porte logique ou d'un circuit à l'étape suivante de la conception.
Effort logique - L'effort logique est une métrique qui représente la vitesse intrinsèque d'une porte logique.

ÉTAPE 1: Convertir les entrées en unité de base

Effort de scène: 3.99 --> Aucune conversion requise
Effort logique: 4.76 --> Aucune conversion requise

ÉTAPE 2: Évaluer la formule

Remplacement des valeurs d'entrée dans la formule

h = f/g --> 3.99/4.76

Évaluer ... ...

h = 0.838235294117647

ÉTAPE 3: Convertir le résultat en unité de sortie

0.838235294117647 --> Aucune conversion requise

RÉPONSE FINALE

0.838235294117647 ≈ 0.838235 <-- Fanout

(Calcul effectué en 00.020 secondes)

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Accueil » Ingénierie » Électronique » Conception et applications CMOS » Sous-système CMOS à usage spécial » Fanout de la porte

Crédits

Créé par Shobhit Dimri

Institut de technologie Bipin Tripathi Kumaon (BTKIT), Dwarahat

Shobhit Dimri a créé cette calculatrice et 900+ autres calculatrices!

Vérifié par Urvi Rathod

Collège d'ingénierie du gouvernement de Vishwakarma (VGEC), Ahmedabad

Urvi Rathod a validé cette calculatrice et 1900+ autres calculatrices!

< 20 Sous-système CMOS à usage spécial Calculatrices

Résistance thermique entre la jonction et l'air ambiant

Aller Résistance thermique entre jonction et ambiance = Transistors de différence de température/Consommation électrique de la puce

Différence de température entre les transistors

Aller Transistors de différence de température = Résistance thermique entre jonction et ambiance*Consommation électrique de la puce

Résistance série de la matrice au boîtier

Aller Résistance série de la matrice au boîtier = Résistance thermique entre jonction et ambiance-Résistance série du colis à l’air

Consommation électrique de la puce

Aller Consommation électrique de la puce = Transistors de différence de température/Résistance thermique entre jonction et ambiance

Résistance série du colis à l'air

Aller Résistance série du colis à l’air = Résistance thermique entre jonction et ambiance-Résistance série de la matrice au boîtier

Puissance de l'onduleur

Aller Puissance de l'onduleur = (Retard des chaînes-(Effort électrique 1+Effort électrique 2))/2

Effort électrique de l'inverseur 1

Aller Effort électrique 1 = Retard des chaînes-(Effort électrique 2+2*Puissance de l'onduleur)

Invertor Electric Effort 2

Aller Effort électrique 2 = Retard des chaînes-(Effort électrique 1+2*Puissance de l'onduleur)

Délai pour deux onduleurs en série

Aller Retard des chaînes = Effort électrique 1+Effort électrique 2+2*Puissance de l'onduleur

Phase d'horloge de sortie PLL

Aller Phase d'horloge de sortie PLL = Fonction de transfert PLL*Phase d'horloge de référence d'entrée

Fonction de transfert de PLL

Aller Fonction de transfert PLL = Phase d'horloge de sortie PLL/Phase d'horloge de référence d'entrée

Phase d'horloge d'entrée PLL

Aller Phase d'horloge de référence d'entrée = Phase d'horloge de sortie PLL/Fonction de transfert PLL

Erreur du détecteur de phase PLL

Aller Détecteur d'erreur PLL = Phase d'horloge de référence d'entrée- Horloge de rétroaction PLL

Horloge de rétroaction PLL

Aller Horloge de rétroaction PLL = Phase d'horloge de référence d'entrée-Détecteur d'erreur PLL

Changement de phase de l'horloge

Aller Changement de phase d'horloge = Phase d'horloge de sortie PLL/Fréquence absolue

Changement de fréquence d'horloge

Aller Changement de fréquence d'horloge = Fanout/Fréquence absolue

Capacité de charge externe

Aller Capacité de charge externe = Fanout*Capacité d'entrée

Fanout de la porte

Aller Fanout = Effort de scène/Effort logique

Effort de scène

Aller Effort de scène = Fanout*Effort logique

Délai de porte

Aller Retard de porte = 2^(SRAM à N bits)

Fanout de la porte Formule

Fanout = Effort de scène/Effort logique
h = f/g

Qu’est-ce que l’effort scénique ?

L'effort d'étage est une mesure de l'effort nécessaire pour piloter la capacité de charge de l'étage suivant dans un circuit CMOS. Il prend en compte le retard intrinsèque de la grille et la capacité de charge qu'elle pilote.

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