बिटलाइनवर व्होल्टेज स्विंग उपाय

चरण 0: पूर्व-गणन सारांश
फॉर्म्युला वापरले जाते
बिटलाइनवर व्होल्टेज स्विंग = (सकारात्मक व्होल्टेज/2)*सेल कॅपेसिटन्स/(सेल कॅपेसिटन्स+बिट कॅपेसिटन्स)
ΔV = (Vdd/2)*Ccell/(Ccell+Cbit)
हे सूत्र 4 व्हेरिएबल्स वापरते
व्हेरिएबल्स वापरलेले
बिटलाइनवर व्होल्टेज स्विंग - (मध्ये मोजली व्होल्ट) - बिटलाइनवरील व्होल्टेज स्विंगची व्याख्या पूर्ण-स्विंग स्थानिक बिटलाइन एसआरएएम आर्किटेक्चर म्हणून केली जाते, जी कमी-व्होल्टेज ऑपरेशनसाठी 22-nm FinFET तंत्रज्ञानावर आधारित आहे.
सकारात्मक व्होल्टेज - (मध्ये मोजली व्होल्ट) - पॉझिटिव्ह व्होल्टेज हे सर्किट पॉवर सप्लायशी जोडलेले असताना मोजले जाणारे व्होल्टेज म्हणून परिभाषित केले जाते. याला सहसा व्हीडीडी किंवा सर्किटचा पॉवर सप्लाय म्हणतात.
सेल कॅपेसिटन्स - (मध्ये मोजली फॅरड) - सेल कॅपेसिटन्स ही वैयक्तिक सेलची कॅपेसिटन्स आहे.
बिट कॅपेसिटन्स - (मध्ये मोजली फॅरड) - बिट कॅपेसिटन्स ही cmos vlsi मधील एक बिटची क्षमता आहे.
चरण 1: इनपुट ला बेस युनिटमध्ये रूपांतरित करा
सकारात्मक व्होल्टेज: 2.58 व्होल्ट --> 2.58 व्होल्ट कोणतेही रूपांतरण आवश्यक नाही
सेल कॅपेसिटन्स: 5.98 पिकोफॅरड --> 5.98E-12 फॅरड (रूपांतरण तपासा ​येथे)
बिट कॅपेसिटन्स: 12.38 पिकोफॅरड --> 1.238E-11 फॅरड (रूपांतरण तपासा ​येथे)
चरण 2: फॉर्म्युलाचे मूल्यांकन करा
फॉर्म्युलामध्ये इनपुट व्हॅल्यूजची स्थापना करणे
ΔV = (Vdd/2)*Ccell/(Ccell+Cbit) --> (2.58/2)*5.98E-12/(5.98E-12+1.238E-11)
मूल्यांकन करत आहे ... ...
ΔV = 0.42016339869281
चरण 3: निकाल आउटपुटच्या युनिटमध्ये रूपांतरित करा
0.42016339869281 व्होल्ट --> कोणतेही रूपांतरण आवश्यक नाही
अंतिम उत्तर
0.42016339869281 0.420163 व्होल्ट <-- बिटलाइनवर व्होल्टेज स्विंग
(गणना 00.004 सेकंदात पूर्ण झाली)

जमा

Creator Image
ने निर्मित शोभित दिमरी
बिपिन त्रिपाठी कुमाऊँ तंत्रज्ञान तंत्रज्ञान (बीटीकेआयटी), द्वाराहाट
शोभित दिमरी यांनी हे कॅल्क्युलेटर आणि 900+ अधिक कॅल्क्युलेटर तयार केले आहेत!
Verifier Image
द्वारे सत्यापित उर्वी राठोड
विश्वकर्मा शासकीय अभियांत्रिकी महाविद्यालय (व्हीजीईसी), अहमदाबाद
उर्वी राठोड यानी हे कॅल्क्युलेटर आणि 1900+ अधिक कॅल्क्युलेटर सत्यापित केले आहेत।

19 अॅरे डेटापथ उपप्रणाली कॅल्क्युलेटर

मल्टिप्लेक्सर विलंब
​ जा मल्टीप्लेक्सर विलंब = (कॅरी-स्किप अॅडर विलंब-(प्रसार विलंब+(2*(एन-इनपुट आणि गेट-1)*आणि-किंवा गेट विलंब)-XOR विलंब))/(के-इनपुट आणि गेट-1)
कॅरी-स्किप अ‍ॅडर विलंब
​ जा कॅरी-स्किप अॅडर विलंब = प्रसार विलंब+2*(एन-इनपुट आणि गेट-1)*आणि-किंवा गेट विलंब+(के-इनपुट आणि गेट-1)*मल्टीप्लेक्सर विलंब+XOR विलंब
कॅरी-लूकर अॅडर विलंब
​ जा कॅरी-लूकर अॅडर विलंब = प्रसार विलंब+गट प्रसार विलंब+((एन-इनपुट आणि गेट-1)+(के-इनपुट आणि गेट-1))*आणि-किंवा गेट विलंब+XOR विलंब
गेट्स मध्ये गंभीर विलंब
​ जा गेट्स मध्ये गंभीर विलंब = प्रसार विलंब+(एन-इनपुट आणि गेट+(के-इनपुट आणि गेट-2))*आणि-किंवा गेट विलंब+मल्टीप्लेक्सर विलंब
कॅरी-इग्मेंमेंटर अ‍ॅडर विलंब
​ जा कॅरी-इन्क्रिमेंटर अॅडर विलंब = प्रसार विलंब+गट प्रसार विलंब+(के-इनपुट आणि गेट-1)*आणि-किंवा गेट विलंब+XOR विलंब
गट प्रसार विलंब
​ जा प्रसार विलंब = ट्री अॅडर विलंब-(log2(परिपूर्ण वारंवारता)*आणि-किंवा गेट विलंब+XOR विलंब)
ट्री अ‍ॅडर विलंब
​ जा ट्री अॅडर विलंब = प्रसार विलंब+log2(परिपूर्ण वारंवारता)*आणि-किंवा गेट विलंब+XOR विलंब
सेल कॅपेसिटन्स
​ जा सेल कॅपेसिटन्स = (बिट कॅपेसिटन्स*2*बिटलाइनवर व्होल्टेज स्विंग)/(सकारात्मक व्होल्टेज-(बिटलाइनवर व्होल्टेज स्विंग*2))
बिट कॅपेसिटन्स
​ जा बिट कॅपेसिटन्स = ((सकारात्मक व्होल्टेज*सेल कॅपेसिटन्स)/(2*बिटलाइनवर व्होल्टेज स्विंग))-सेल कॅपेसिटन्स
बिटलाइनवर व्होल्टेज स्विंग
​ जा बिटलाइनवर व्होल्टेज स्विंग = (सकारात्मक व्होल्टेज/2)*सेल कॅपेसिटन्स/(सेल कॅपेसिटन्स+बिट कॅपेसिटन्स)
ग्राउंड कॅपेसिटन्स
​ जा ग्राउंड कॅपेसिटन्स = ((आक्रमक व्होल्टेज*समीप कॅपेसिटन्स)/बळी व्होल्टेज)-समीप कॅपेसिटन्स
'XOR' विलंब
​ जा XOR विलंब = तरंग वेळ-(प्रसार विलंब+(गेट्स ऑन क्रिटिकल पाथ-1)*आणि-किंवा गेट विलंब)
कॅरी-रिपल अॅडर गंभीर मार्ग विलंब
​ जा तरंग वेळ = प्रसार विलंब+(गेट्स ऑन क्रिटिकल पाथ-1)*आणि-किंवा गेट विलंब+XOR विलंब
N बिट्स असलेले मेमरी क्षेत्र
​ जा मेमरी सेलचे क्षेत्रफळ = (वन बिट मेमरी सेलचे क्षेत्रफळ*परिपूर्ण वारंवारता)/अॅरे कार्यक्षमता
मेमरी सेलचे क्षेत्रफळ
​ जा वन बिट मेमरी सेलचे क्षेत्रफळ = (अॅरे कार्यक्षमता*मेमरी सेलचे क्षेत्रफळ)/परिपूर्ण वारंवारता
अॅरे कार्यक्षमता
​ जा अॅरे कार्यक्षमता = (वन बिट मेमरी सेलचे क्षेत्रफळ*परिपूर्ण वारंवारता)/मेमरी सेलचे क्षेत्रफळ
एन-बिट कॅरी-स्किप अॅडर
​ जा एन-बिट कॅरी स्किप अॅडर = एन-इनपुट आणि गेट*के-इनपुट आणि गेट
के-इनपुट 'आणि' गेट
​ जा के-इनपुट आणि गेट = एन-बिट कॅरी स्किप अॅडर/एन-इनपुट आणि गेट
एन-इनपुट 'आणि' गेट
​ जा एन-इनपुट आणि गेट = एन-बिट कॅरी स्किप अॅडर/के-इनपुट आणि गेट

बिटलाइनवर व्होल्टेज स्विंग सुत्र

बिटलाइनवर व्होल्टेज स्विंग = (सकारात्मक व्होल्टेज/2)*सेल कॅपेसिटन्स/(सेल कॅपेसिटन्स+बिट कॅपेसिटन्स)
ΔV = (Vdd/2)*Ccell/(Ccell+Cbit)

डायनॅमिक रॅम (डीआरएएम) म्हणजे काय?

डायनॅमिक रॅम (डीआरएएम) फीडबॅक लूपमध्ये न ठेवता कॅपेसिटरवर चार्ज म्हणून त्यांची सामग्री साठवतात. व्यावसायिक DRAM दाट कॅपेसिटर स्ट्रक्चर्ससाठी ऑप्टिमाइझ केलेल्या विशेष प्रक्रियांमध्ये तयार केले जातात. ते मानक लॉजिक प्रक्रियेमध्ये तयार केलेल्या उच्च-कार्यक्षमता SRAM पेक्षा 10-20 जास्त घनतेचा (बिट्स/cm2) एक घटक देतात, परंतु त्यांच्याकडे खूप जास्त विलंब देखील आहे. कॅपेसिटरला बिटलाइनशी जोडण्यासाठी वर्डलाइनचा दावा करून सेलमध्ये प्रवेश केला जातो. वाचल्यावर, बिटलाइन प्रथम VDD/2 वर प्रीचार्ज केली जाते. जेव्हा वर्डलाइन वाढते, तेव्हा कॅपेसिटर त्याचा चार्ज बिटलाइनसह सामायिक करतो, ज्यामुळे व्होल्टेज बदल होतो जो जाणवू शकतो. वाचन सेलच्या सामग्रीस x वर अडथळा आणते, म्हणून प्रत्येक वाचनानंतर सेल पुन्हा लिहिला जाणे आवश्यक आहे. राइटवर, बिटलाइन उच्च किंवा कमी चालविली जाते आणि कॅपेसिटरवर व्होल्टेज सक्ती केली जाते. काही DRAM '1' लिहिताना खालावलेली पातळी टाळण्यासाठी VDDP = VDD Vt वर वर्डलाइन चालवतात.

Let Others Know
Facebook
Twitter
Reddit
LinkedIn
Email
WhatsApp
Copied!